电源纹波导致本振出现杂散？VCO 推频与供电测试

电源纹波导致本振出现杂散？VCO 推频与供电测试 

现象很典型：本振输出谱线干净，旁边却冒出一组等间隔的 "梳子齿"—— 杂散。它们的间隔不是参考杂散、不是鉴相杂散，而是和板上 DC/DC 电源的开关频率对得上。 

这就是电源纹波通过 VCO 推频（VCO Pushing）调制了本振：DC/DC 的开关纹波窜进 VCO 供电，把电源电压的起伏直接变成输出频率的起伏，等效给本振加了一个 FM 调制，在谱线上开出 f_LO ± f_纹波、f_LO ± 2・f_纹波…… 一串边带杂散。 

这篇文章给你一套定位流程：先找到 DC/DC 开关频率，再注入已知纹波量出推频系数，最后做电源隔离测试坐实根因。 

一、先认出现象：杂散的间隔就是答案 

拿到本振频谱，先看两件事：
• 杂散间隔是多少？
• 板上各路电源的开关频率（DC/DC switching frequency）是多少？ 

如果杂散间隔 = DC/DC 开关频率（或它的倍频、分频），且幅度随负载、电源模式变化，基本就能锁定是电源路径引入的。真正坐实还要靠下面的注入与隔离测试。 

二、机理：纹波怎么变成频率调制（VCO 推频） 

VCO 的输出频率对供电电压敏感，这个指标叫电源推频（supply pushing），单位通常是 MHz/V 或 ppb/V。 

DC/DC 开关电源在 VCO 供电脚上留下 mV 级的开关纹波（通常几百 kHz 到几 MHz）。这毫伏级纹波叠加在 VCO 电源上，经推频系数折算成频率偏移 Δf： 

Δf = 电源推频系数（MHz/V）× 纹波幅度（V） 

这个 Δf 随开关周期不断变化，等效于对本振做了一次 FM 调制。FM 调制在频谱上的结果，就是在本振载波两侧开出以开关频率为间隔的边带 —— 也就是你看到的 "梳子齿"。纹波越大、推频越高、去耦越差，边带越高。 

三、第一步：用示波器定位 DC/DC 开关频率 

在 VCO 供电脚（就近的去耦电容两端）用示波器交流耦合测一下：
• 找出开关纹波的基频 f_SW 和幅度 V_ripple（mV 级）；
• 顺便记录它的各次谐波；
• 对比本振频谱上杂散的间隔 —— 如果杂散落在 f_LO ± n・f_SW（n=1,2,3…），方向就对了。
这一步只做 "对上号"，还不能下最终结论。 

四、第二步：注入已知纹波，量出推频系数 

用信号发生器经 bias-T 或直接在 VCO 供电端注入一个已知幅度、已知频率的小信号纹波（幅度从几十 mV 起，频率贴近 DC/DC 开关频率），然后在本振频谱上测： 

注入幅度 V_in（mV）；

测出本振边带的频率偏移 Δf；
推算推频系数：推频 = Δf ÷ V_in（MHz/V 或 ppb/V）。
再看两个关键现象：

边带幅度是否随注入纹波幅度单调正比变化？如果是，说明纹波确实直接调制了 VCO。注意这里不是 1:1——边带幅度与调制指数 β = Δf / f_m 有关，小调制指数下一阶边带幅度约正比于 β，即正比于纹波幅度，但比例系数由贝塞尔函数展开项决定，不等于 1。

边带相对载波的频率间隔是否严格等于注入频率？如果是，根因就在这条电源线上。边带本身落在 f_LO ± n·f_in 处，不是落在 f_in 处。 

这一步把"猜测"变成了"可量化的推频系数"，也能和 Datasheet 上的推频指标对比，判断 VCO 本身是否超标或去耦是否失效。 

五、第三步：电源隔离测试清单（逐项验证）

按下面顺序逐项做，每做一项看本振杂散改善多少： 

1. 切换供电来源：把 VCO 从 DC/DC 轨切到 LDO / 线性电源（或电池 / 实验室电源），再看杂散。杂散显著下降 → 电源路径是主因。

2. 在 VCO 供电与 DC/DC 之间加磁珠：串一颗合适的磁珠（对开关频率呈高阻）。杂散被磁珠衰减 → 坐实纹波经电源灌入。 

3. 加 π 型滤波（磁珠 + 对地电容）：在 VCO 就近做一级 LC/π 滤波。杂散进一步下降，说明可用滤波结构解决。 

4. 强化去耦：就近补 10 μF + 0.1 μF + 1000 pF 不同容值去耦电容，注意布局在 VCO 引脚正下方。杂散随去耦改善 → 是纹波未被滤净。

5. 区分 "供电推频" 和 "调谐线牵注"：把注入纹波改加到调谐（tuning）线上，看杂散是否变化。如果杂散跟着调谐线走而不跟电源线，那是 PLL / 调谐路径的问题，不是电源推频。 

6. 改 DC/DC 开关频率：能调的话，把 DC/DC 开关频率挪开一段。本振杂散位置随之移动 → 完全坐实电源引入。 

每一步都 "先做、再测、再恢复"，用频谱仪读数说话，不要凭感觉。 

六、常见解决路径 

坐实根因后，按成本从低到高： 

1. 强化 VCO 引脚就近去耦（多容值并联，布局紧凑）；
2. 磁珠 + π 滤波把 VCO 与 DC/DC 隔离开；
3. VCO/PLL 部分用 LDO 从 DC/DC 后级独立供电；
4. 选低推频、低电源敏感度的 VCO；
5. DC/DC 布局远离本振，避免共地耦合；
6. 必要时重排 DC/DC 开关频率，避开本振敏感边带位置。 

七、Dynamic Engineers 能提供什么

这类问题的最终解决，往往落在低电源敏感度、低相噪的 VCO 与 PLL 方案上。Dynamic Engineers, Inc. 可提供： 

• VCO（压控振荡器）：低推频、低电源敏感度、低相噪选型；
• PLL 频率合成器：配合环路设计降低杂散与边带；
• OCXO / TCXO / VCXO：低相噪参考源，压低近端底噪与参考杂散；
• 配套滤波（SAW / 陶瓷 / LC）：本振输出与电源路径的杂散抑制。 

总结 

本振旁边的 "梳子齿" 杂散，先看间隔是否等于 DC/DC 开关频率；再注入已知纹波量出推频系数，看边带是否随纹波单调正比变化；最后通过 LDO 切换、磁珠、π 滤波、强化去耦逐项隔离。杂散位置跟着开关频率走、切线性电源就下降、加磁珠就衰减 —— 就是电源纹波经 VCO 推频调制了本振。 解决思路是隔离 + 去耦 + 选低推频 VCO，而不是在本振输出端硬滤。 

正在被本振电源杂散或 VCO 推频困扰？欢迎把 VCO 型号、供电纹波测试数据和频谱截图发给 Dynamic Engineers，我们的工程团队可协助评估低推频 VCO/PLL 方案与替代料号。 

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